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1.
Design and implementation of an ultra-low energy FFT ASIC for processing ECG in Cardiac Pacemakers.
IEEE Trans Very Large Scale Integr VLSI Syst
; 27(4): 983-987, 2019 Apr.
Artículo
en Inglés
| MEDLINE | ID: mdl-32051675
2.
Reducing Power and Cycle Requirement for FFT of ECG Signals through Low Level Arithmetic Optimizations for Cardiac Implantable Devices.
J Low Power Electron
; 12(1): 21-29, 2016 Mar.
Artículo
en Inglés
| MEDLINE | ID: mdl-29542735
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